贴装内存卡连接器测试装置的制作方法

xiaoxiao2020-7-23  11

专利名称:贴装内存卡连接器测试装置的制作方法
技术领域
本发明涉及一种连接器测试装置,特别是一种贴装内存卡连接器测试装置。
背景技术
随着主板架构及技术的发展,主板上的内存卡连接器逐渐由过去的插件内存卡连 接器发展为贴装内存卡连接器。现在,越来越多的高端电子产品开始使用贴装内存卡连接 器。对应地,电子产品上的内存卡插槽也逐渐由插件内存槽发展为贴装内存槽。由于内存 卡连接器针脚数量多、封装精密、体积大,因而给生产制程和测试带来了较大的困难。特别 是在对连接器针脚焊点的开路以及短路测试时,传统的ICT(In Current Test)测试由于没 有测试点因此测试不了这种贴装连接器,而飞针测试由于容易造成连接器针脚的损坏,因 而也无法对贴装内存槽连接器进行测试,业界暂时没有这类连接器的测试设备。

发明内容
鉴于以上内容,有必要提供一种贴装内存卡连接器测试装置。一种贴装内存卡连接器测试装置,用于对一待测主板上的贴装内存卡连接器进行 测试,包括一主控电路、分别与所述主控电路电性相连的至少一数据采集电路、及一显示单 元,所述主控电路中存储有正常的贴装内存卡连接器的针脚信息,所述至少一数据采集电 路与所述至少一贴装内存卡连接器对应连接以采集所述贴装内存卡连接器的针脚信息,所 述主控电路通过所述数据采集电路控制所述贴装内存卡连接器的针脚接收来自所述数据 采集电路的数据,所述数据采集电路采集所述贴装内存卡连接器针脚接收的数据并传送给 所述主控电路,所述主控电路将采集到的数据与正常的针脚信息进行比较,并将比较结果 显示在所述显示单元上提示待测主板上的阵列型连接器的针脚是否正常。优选地,所述数据采集电路向所述贴装内存卡连接器的对应针脚发送两次相反的 数据,如果所述内存卡连接器的针脚两次接收到的数据均与数据采集电路发送的数据一 致,则所述内存卡连接器的针脚正常,如果两次接收的数据与数据采集电路发送的数据不 同,则所述针脚异常。优选地,所述数据采集电路包括一复杂可编程逻辑器件,所述复杂可编程逻辑器 件包括若干数据采集引脚、一数据传送引脚及至少一时钟引脚,所述数据采集引脚分别电 性连接待测主板上的贴装内存卡连接器针脚并采集针脚信息,所述复杂可编程逻辑器件对 采集到的针脚信息进行处理后由数据传送输出至所述主控电路。优选地,所述数据采集电路还包括一与所述复杂可编程逻辑器件及所述主控电路 连接的电压信号采集单元,所述电压信号采集单元采集所述贴装内存卡连接器针脚的电压 信号并发送至所述主控电路。优选地,所述电压信号采集单元包括若干电压信号采集引脚、一第一数据传送引 脚、一第二数据传送引脚、一第一时钟引脚、一第二时钟引脚,所述第一数据传送引脚与所 述复杂可编程逻辑器件的数据传送引脚相连,所述第一时钟引脚与所述复杂可编程逻辑器
4件的时钟引脚相连,所述电压信号采集引脚分别电性连接待测主板上的贴装内存卡连接器 针脚以采集电压信息,所述复杂可编程逻辑器件对采集到的针脚信息进行处理后由所述第 二数据传送引脚输出至所述主控电路。优选地,所述电压信号采集单元还包括一第三数据传送引脚及一第三时钟引脚, 所述存储单元包括一电可擦可编程只读存储器,所述电可擦可编程只读存储器包括一串行 数据引脚、一串行时钟引脚及一写保护引脚,所述第三数据传送引脚和第三时钟引脚分别 连接所述串行数据引脚和串行时钟引脚,所述写保护引脚经由一跳帽接地。优选地,所述主控电路包括一微控制器,所述微控制器包括一数据传送引脚及一 时钟引脚,所述微控制器的数据传送引脚和时钟引脚分别连接所述电压信号采集单元的第 二数据传送引脚和第二时钟引脚,所述微控制器通过所述数据传送引脚及时钟引脚控制所 述电压信号采集单元采集电压信号。优选地,所述微控制器具有若干并行数据传送引脚,所述主控电路还包括一与所 述微控制器连接的通用串行接口解析电路及与所述通用串行接口解析电路电性连接的通 用串行接口,所述通用串行接口解析电路具有若干并行数据引脚,所述通用串行接口解析 电路的并行数据引脚分别与所述微控制器的并行数据传送引脚对应连接,从而实现数据在 所述通用串行接口与微控制器之间的串并/并串转换。优选地,所述显示单元通过所述通用串行接口与所述微控制器实现数据传输。优选地,每一信号采集电路的第二数据传送引脚和第二时钟引脚均对应连接至所 述微控制器的数据传送引脚及时钟引脚。相较于现有技术,本发明贴装内存卡连接器测试装置通过所述主控电路控制数据 采集电路对所述贴装内存卡连接器的各个针脚进行测试,避免了传统测试治具对贴装内存 卡连接器针脚的损坏。


图1是本发明较佳实施方式贴装内存卡连接器测试装置的组成框图,所述阵列型 连接器测试装置包括一待测主板、一数据采集电路、一主控电路、及一显示单元。图2及图3是图1中主控电路的元件电路图。图4及图5是图1中数据采集电路的元件电路图。
具体实施例方式请参阅图1,本发明贴装内存卡连接器测试装置较佳实施方式包括一待测主板 10、一数据采集电路30、一主控电路50、及一显示单元60。所述待测主板10上设置若干个贴装内存卡连接器20。所述内存卡连接器20具有若干个 针脚Bl Bn及Il In(见图4)。所述数据采集电路30与所述贴装内存卡连接器20电 性连接以采集所述贴装内存卡连接器20的针脚信息,并将采集到的针脚信息传送给所述 主控电路50。所述主控电路50中存储有正常的针脚信息。所述显示单元60与所述主控电 路50相连。所述主控电路50将采集到针脚信息进行比较处理后得出测试结果,并将所述 测试结果发送至显示单元60显示。请参阅图2及图3,所述主控电路50包括一通用串行(USB)接口 Jl、一 USB解析电路U1、及一微控制器U3。请参阅图2,所述USB解析电路Ul具有若干并行数据引脚EO En,若干控制引脚 R、W、TXE, RXF,若干电源引脚VCC、AVCC,接地引脚GND,振荡信号输入端XOl、XI1。所述USB 接口 Jl具有电源端VCC,接地端GND,及两个信号传输端DN、DP。所述USB接口 Jl的电源端 通过一电感L与所述USB解析电路Ul的其中两个电源引脚VCC、AVCC相连,并经由一跳帽 J2连接至显示单元60提供的一 USB电源USBVl。所述USB解析电路Ul的另一电源引脚VCC 连接至一 3. 3V工作电源。所述振荡信号输入端X01、XIl经由一 6M的晶振J3接地。所述 USB接口 Jl的两个信号传输端DN、DP分别与所述USB解析电路Ul的信号传输引脚USBM、 USBP及一复位引脚RSTO连接。所述显示单元60通过所述USB接口 Jl与所述USB解析电 路Ul连接并实现数据传输。所述USB解析电路Ul还具有一时钟引脚ESK、一数据传输引脚 DATA、及一片选端ECS。所述USB解析电路Ul通过所述时钟引脚ESK、数据引脚DATA、及片 选端ECS与一第一存储单元U2连接。所述数据引脚DATA通过两个电阻连接至所述USB电 源USBV1。所述第一存储单元U2用以存储所述USB模块的ID等相关信息。请参阅图3,所述微控制器U3具有与所述USB解析电路Ul对应的若干并行数据引 脚DO Dn及控制引脚R、W、TXE、RXF,所述USB解析电路Ul通过所述并行数据引脚DO Dn及控制引脚R、W、TXE、RXF与所述微控制器U3连接,从而将USB接口 Jl传送的串行数据 转换为并行数据传送给所述微控制器U3,并将微控制器U3传送的并行数据转换为串行数 据传送至USB接口 Jl。所述USB接口 Jl再将数据传送至显示单元60显示。所述微控制器 U3还具有若干程序烧录引脚MCLR、P⑶、PGC,振荡信号输入引脚0SC1、0SC2,电源引脚VDD, 接地引脚VSS,一时钟引脚Cl,一数据传输引脚C2。所述振荡信号输入引脚0CS1、0CS2经 由一 12M的晶振J4及两个电容接地。所述时钟引脚Cl及数据传输引脚C2分别与一数据 传输连接器J8的时钟信号端CLK及数据信号端DATA连接,并分别通过一电阻连接至3. 3V 电源。请参阅图4及图5,所述数据采集电路30包括一复杂可编程逻辑器件TO、一电压 信号采集单元U6,及一与所述电压信号采集单元U6电性连接的第二存储单元U8。请参阅图4,所述复杂可编程逻辑器件U5包括若干数据采集引脚Al An、Bn、若 干振荡信号输入引脚CLKO CLK3、一时钟引脚Si、一数据传送引脚S2、若干程序烧入引 脚100、101、11^、10(、若干控制引脚61 611、若干电源引脚¥01 ¥011及若干接地引脚 GNDl GNDn。所述若干数据采集引脚Al An分别连接至所述贴装内存卡连接器20的针 脚Bl Bn。所述振荡信号输入引脚CLKO CLK3连接至一个25M的晶振J5。所述若干电 源引脚VCCl VCCn连接所述3. 3V电源,所述若干接地引脚GNDl GNDn接地。请参阅图5,所述电压信号采集单元U6包括若干电压采集引脚Fl Fn,若干控制 引脚Hl Hn,若干程序烧入引脚P⑶、PGC、MCLF,两个振荡信号输入引脚0SC1、0SC2。一第 一时钟引脚M1,一第一数据传送引脚M2,一第二时钟引脚SCL,一第二数据传送引脚SDA,电 源引脚VDD,接地引脚VSS。所述电压采集引脚Fl Fn分别连接至所述贴装内存卡连接器 20的针脚Il In。所述两个振荡信号输入引脚0SC1、0SC2连接至一 12M的晶振J10。所 述第一时钟引脚Ml连接至所述复杂可编程逻辑器件U5的时钟引脚Si,所述第一数据传送 引脚M2连接至所述复杂可编程逻辑器件TO的数据传送引脚。所述第二时钟引脚SCL连接 至所述数据传输连接器J8的时钟信号端CLK,所述第二时钟引脚SDA连接至所述数据传输
6连接器J8的数据信号端DATA。如此,所述电压信号采集单元TO即可通过所述数据传输连 接器J8连接至所述微控制器U3。所述第二存储单元U8为一电可擦可编程只读存储器。所述电可擦可编程只读存 储器U8包括一串行时钟引脚SCL、一串行数据引脚SDA及一写保护引脚WP。所述串行时钟 引脚SCL和串行数据引脚SDA连接至所述电压信号采集单元TO,所述写保护引脚WP经由一 跳帽J9接地。当短接所述跳帽J9时可对电可擦可编程只读存储器U8进行写入信息的操 作,而当断开所述跳帽J9时禁止对电可擦可编程只读存储器U8进行擦除信息的操作。测试时,按照图1-5所示连接所述贴装内存卡连接器测试装置,所述复杂可编程 逻辑器件U5的数据采集引脚Al An分别采集待测主板10上的贴装内存卡连接器20的 针脚信息,并将采集到的针脚信息进行处理后由数据发送引脚Sl经由电压信号采集单元 的第一数据发送引脚Ml发送给所述电压信号采集单元U6。同时,所述电压信号采集单元 U6的电压信号采集引脚Fl Fn采集待测主板10上的贴装内存卡连接器20的电压信号信 息。所述电压信号采集单元U6将电压信号信息及复杂可编程逻辑器件U5采集到的针脚信 息发送至所述第二存储单元U8内。所述微控制器U2从所述第二存储单元U8中读取所述 针脚信息及信号电压信息并与正常的针脚信息进行比较,然后将比较结果发送至所述显示 单元60上以提示待测主板10上的贴装内存卡连接器20的针脚是否正常。所述多个数据采集电路30的电压信号采集单元TO的时钟引脚SCL及数据传输引 脚SDA均通过所述数据传输连接器J8连接至所述微控制器U3的时钟引脚Cl及数据传送 引脚C2。所述微控制器U3与所述数据采集电路30之间,所述数据采集电路30与所述贴 装内存卡连接器20之间通过双向数据传送的方式进行通讯。测试时,所述微控制器U3通 过所述多个数据采集电路30分别控制对应的贴装内存卡连接器20的针脚从所述数据采集 电路30接收数据。所述数据采集电路30分别发送两次相反的数据至所述贴装内存卡连接 器20的对应针脚。如果所述贴装内存卡连接器20的针脚两次接收到的数据均与所述数据 采集电路30发送的数据一致,则贴装内存卡连接器20的针脚正常;否则,贴装内存卡连接 器20的针脚异常。所述数据采集电路30采集所述贴装内存卡连接器20各个针脚的信息 发送给所述微控制器U3。所述微控制器U3将所述数据与正常的针脚信息进行比较,并将比 较结果通过所述USB解析电路Ul转换为串行数据,经由所述USB接口 Jl发送至显示单元 60。所述显示单元60对比较结果进行进一步处理,将所述贴装内存卡连接器20针脚的具 体信息显示出来。
权利要求
一种贴装内存卡连接器测试装置,用于对一待测主板上的贴装内存卡连接器进行测试,包括一主控电路、分别与所述主控电路电性相连的至少一数据采集电路、及一显示单元,所述主控电路中存储有正常的贴装内存卡连接器的针脚信息,所述至少一数据采集电路与所述至少一贴装内存卡连接器对应连接以采集所述贴装内存卡连接器的针脚信息,所述主控电路通过所述数据采集电路控制所述贴装内存卡连接器的针脚接收来自所述数据采集电路的数据,所述数据采集电路采集所述贴装内存卡针脚接收的数据并传送给所述主控电路,所述主控电路将采集到的数据与正常的针脚信息进行比较,并将比较结果显示在所述显示单元上以提示待测主板上的阵列型连接器的针脚是否正常。
2.如权利要求1所述的贴装内存卡连接器测试装置,其特征在于所述数据采集电路 向所述贴装内存卡连接器的对应针脚发送两次相反的数据,如果所述内存卡连接器的针脚 两次接收到的数据均与数据采集电路发送的数据一致,则所述内存卡连接器的针脚正常, 如果两次接收的数据与数据采集电路发送的数据不同,则所述针脚异常。
3.如权利要求1所述的贴装内存卡连接器测试装置,其特征在于所述数据采集电路 包括一复杂可编程逻辑器件,所述复杂可编程逻辑器件包括若干数据采集引脚、一数据传 送引脚及至少一时钟引脚,所述数据采集引脚分别电性连接待测主板上的贴装内存卡连接 器针脚并采集针脚信息,所述复杂可编程逻辑器件对采集到的针脚信息进行处理后由数据 传送输出至所述主控电路。
4.如权利要求3所述的贴装内存卡连接器测试装置,其特征在于所述数据采集电路 还包括一与所述复杂可编程逻辑器件及所述主控电路连接的电压信号采集单元,所述电压 信号采集单元采集所述贴装内存卡连接器针脚的电压信号并发送至所述主控电路。
5.如权利要求4所述的贴装内存卡连接器测试装置,其特征在于所述电压信号采集 单元包括若干电压信号采集引脚、一第一数据传送引脚、一第二数据传送引脚、一第一时钟 引脚、一第二时钟引脚,所述第一数据传送引脚与所述复杂可编程逻辑器件的数据传送引 脚相连,所述第一时钟引脚与所述复杂可编程逻辑器件的时钟引脚相连,所述电压信号采 集引脚分别电性连接待测主板上的贴装内存卡连接器针脚以采集电压信息,所述复杂可编 程逻辑器件对采集到的针脚信息进行处理后由所述第二数据传送引脚输出至所述主控电 路。
6.如权利要求5所述的贴装内存卡连接器测试装置,其特征在于所述电压信号采集 单元还包括一第三数据传送引脚及一第三时钟引脚,所述存储单元包括一电可擦可编程只 读存储器,所述电可擦可编程只读存储器包括一串行数据引脚、一串行时钟引脚及一写保 护引脚,所述第三数据传送引脚和第三时钟引脚分别连接所述串行数据引脚和串行时钟引 脚,所述写保护引脚经由一跳帽接地。
7.如权利要求5所述的贴装内存卡连接器测试装置,其特征在于所述主控电路包括 一微控制器,所述微控制器包括一数据传送引脚及一时钟引脚,所述微控制器的数据传送 引脚和时钟引脚分别连接所述电压信号采集单元的第二数据传送引脚和第二时钟引脚,所 述微控制器通过所述数据传送引脚及时钟引脚控制所述电压信号采集单元采集电压信号。
8.如权利要求7所述的贴装内存卡连接器测试装置,其特征在于所述微控制器具有 若干并行数据传送引脚,所述主控电路还包括一与所述微控制器连接的通用串行接口解析 电路及与所述通用串行接口解析电路电性连接的通用串行接口,所述通用串行接口解析电路具有若干并行数据引脚,所述通用串行接口解析电路的并行数据引脚分别与所述微控制 器的并行数据传送引脚对应连接,从而实现数据在所述通用串行接口与微控制器之间的串并/并串转换。
9.如权利要求8所述的贴装内存卡连接器测试装置,其特征在于所述显示单元通过 所述通用串行接口与所述微控制器实现数据传输。
10.如权利要求7所述的贴装内存卡连接器测试装置,其特征在于每一个信号采集电 路的第二数据传送引脚和第二时钟引脚均对应连接至所述微控制器的数据传送引脚及时 钟引脚。
全文摘要
一种贴装内存卡连接器测试装置,包括一主控电路、分别与所述主控电路电性相连的至少一数据采集电路、及一显示单元,所述主控电路中存储有正常的贴装内存卡连接器的针脚信息,所述至少一数据采集电路与所述至少一贴装内存卡连接器对应连接以采集所述贴装内存卡连接器的针脚信息,所述主控电路通过所述数据采集电路控制所述贴装内存卡连接器的针脚接收来自所述数据采集电路的数据,所述数据采集电路采集所述贴装内存卡连接器针脚接收的数据并传送给所述主控电路,所述主控电路将采集到的数据与正常的针脚信息进行比较,并将比较结果显示在所述显示单元上提示待测主板上的阵列型连接器的针脚是否正常。
文档编号G01R31/04GK101957419SQ200910304438
公开日2011年1月26日 申请日期2009年7月16日 优先权日2009年7月16日
发明者陈仰新 申请人:鸿富锦精密工业(深圳)有限公司;鸿海精密工业股份有限公司

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