薄膜晶体管液晶显示器的栅极驱动器、驱动电路及液晶显示器的制作方法
专利名称：薄膜晶体管液晶显示器的栅极驱动器、驱动电路及液晶显示器的制作方法
技术领域：
本实用新型涉及液晶显示器驱动技术，尤其涉及一种薄膜晶体管液晶显示器的栅极驱动器、驱动电路及液晶显示器。
背景技术：
液晶显示器是目前常用的平板显示器，其中薄膜晶体管液晶显示器(ThinFilm Transistor Liquid Crystal Display，简称TFT-LCD)是液晶显示器中的主流产品。如图1 所示为现有技术中TFT-LCD的驱动电路结构示意图，时序控制器1用于产生各种控制信号， 例如栅极行开启信号(本领域中通常称为CPV信号(Clock Pulse Vertical，简称CPV))、 栅极帧开启信号(本领域中通常称为STV信号(Mart Vertical，简称STV))、栅极输出使能信号(本领域中通常称为OE信号(Output Enable，简称OE))等。时序控制器1将产生的各种控制信号输入到高电压逻辑驱动器(High VoltageTFT-LCD Logic Driver) 2中，该高电压逻辑驱动器2将CPV信号、STV信号、OE信号等生成第一时钟信号(本领域中通常称为CKV信号)、第二时钟信号(本领域中通常称为CKVB信号)以及改进后STV信号(本领域中通常称为STVP信号)，所谓改进后的STV信号是指电平经过调整后的STV信号，因为时序控制器中输出的STV信号的电平和栅极驱动电路需要的STV信号的电平可能不一致，需要通过一些电平转换电路将STV信号的电平进行转换。CKVB信号、CKV信号和STVP信号输入到栅极驱动电路3中，就可以驱动栅极工作了。TFT-LCD的驱动电路中，通常当栅极驱动电路输出用于开启一行栅线的栅极驱动信号(本领域中通常称为fete信号)时，源极驱动电路将该行栅线对应的各个像素的数据信号输入到该行的各个像素电极上，即当fete信号为高电平时，源极驱动电路向像素电极上输入数据信号。实际应用当中，Gate信号的下降沿有一定的延时，那么当前一行的(iatel 信号正处于下降沿时，后一行的信号已经开始上升，那么也就是说前一行栅线对应的各个TFT还没有关断，这时源极驱动电路已经输入了后一行像素对应的数据，从而导致了前一行像素的数据发生混淆，影响了画面显示的质量。
实用新型内容本实用新型提供一种薄膜晶体管液晶显示器的栅极驱动器、驱动电路及液晶显示器，用以避免由于栅极驱动信号的延迟造成输入到像素电极中的数据混淆。本实用新型提供一种薄膜晶体管液晶显示器的栅极驱动器，包括用于输入CPV信号、OE信号和STV信号的输入端，以及用于输出CKV信号和CKVB信号的输出端，所述输入端与所述输出端之间连接有处理电路，用于对所述CPV信号、所述OE信号和所述STV信号进行处理，以使在所述CKV信号的一个周期内，所述CKV信号的下降沿与所述CKVB信号的上升沿之间具有预先设置的时间间隔，或者在所述CKVB信号的一个周期内，所述CKV信号的上升沿与所述CKVB信号的下降沿之间具有预先设置的时间间隔。[0006]如上所述的薄膜晶体管液晶显示器的栅极驱动器，其中，所述处理电路包括非门 LUD触发器D1、第一与门L2、第二与门L3、第一逻辑组合电路Cl、第一逻辑选择电路L4和第二逻辑选择电路L5，其中，非门Ll的输入端与OE信号输入端连接；非门Ll的输出端分别与第一与门L2的输入端和第二与门L3的输入端连接；D触发器Dl的触发端CKV与CPV信号输入端链接；D触发器Dl的输入端D与反向输出端巧连接；D触发器Dl的反向输出端G与第二与门L3的输入端连接；D触发器Dl的输出端Q与与门L2的输入端连接；D触发器Dl的复位端RST分别与STV信号输入端连接；第一逻辑组合电路Cl的输入端分别与CPV信号输入端、第一与门L2和第二与门 L3的输出端连接；第一逻辑组合电路Cl的输出端分别与第一逻辑选择电路L4和第二逻辑选择电路 L5连接；第一逻辑选择电路L4的输出端与CKV信号输出端连接；第二逻辑选择电路L5的输出端与CKVB信号输出端连接；第一逻辑选择电路L4和第二逻辑选择电路L5分别与参考选择高电压VON和参考选择低电压VOFF连接。如上所述的薄膜晶体管液晶显示器的栅极驱动器，其中，所述输出端还用于输出 STVP信号。如上所述的薄膜晶体管液晶显示器的栅极驱动器，其中，所述时间间隔为所述OE 信号高电平持续的时间。本实用新型提供一种薄膜晶体管液晶显示器的驱动电路，包括源极驱动器和栅极驱动器，其中，所述栅极驱动器采用上述栅极驱动器。本实用新型提供一种薄膜晶体管液晶显示器，包括外框架、液晶面板和驱动电路， 其中，所述驱动电路采用上述薄膜晶体管液晶显示器的驱动电路。本实用新型提供的薄膜晶体管液晶显示器的栅极驱动器、驱动电路及液晶显示器，通过处理电路将现有技术中的STV信号、OE信号和CPV信号生成CKV信号和CKVB信号， 在CKV信号的一个周期内，CKV信号的下降沿与CKVB信号的上升沿之间能够错开一定时间， 或者在CKVB信号的一个周期内，CKVB信号的下降沿与CKV信号的上升沿之间能够错开一定时间，从而能够避免由于栅极驱动信号的延迟造成的输入到像素电极中的数据混淆。
图1为现有技术中薄膜晶体管液晶显示器的驱动电路的结构示意图；图2为本实用新型实施例一提供的薄膜晶体管液晶显示器的栅极驱动器的结构示意图；图3为本实用新型实施例一提供的薄膜晶体管液晶显示器的栅极驱动器的时序图。
具体实施方式
为使本实用新型实施例的目的、技术方案和优点更加清楚，下面将结合本实用新型实施例中的附图，对本实用新型实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例是本实用新型一部分实施例，而不是全部的实施例。基于本实用新型中的实施例，本领域普通技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本实用新型保护的范围。图2为本实用新型实施例一提供的薄膜晶体管液晶显示器的栅极驱动器的结构示意图，如图2所示，本实用新型的薄膜晶体管液晶显示器的栅极驱动器可以包括用于输入CPV信号、OE信号和STV信号的输入端，以及用于输出CKV信号和CKVB信号的输出端，上述输入端与上述输出端之间连接有处理电路，用于对上述CPV信号、上述OE信号和上述STV 信号进行处理，以使在上述CKV信号的一个周期内，上述CKV信号的下降沿与上述CKVB信号的上升沿之间具有预先设置的时间间隔，或者在上述CKVB信号的一个周期内，上述CKV 信号的上升沿与上述CKVB信号的下降沿之间具有预先设置的时间间隔。具体地，上述输入端可以包括输入CPV信号的CPV信号输入端、输入OE信号的OE 信号输入端和输入STV信号的STV信号输入端；上述输出端可以包括输出CKV信号的CKV 信号输出端和输出CKVB信号的CKVB信号输出端。具体地，输入端INPUT可以包括CPV信号输入端、OE信号输入端和STV信号输入端。输出端OUTPUT可以包括CKV信号输出端和CKVB信号输出端。处理电路可以包括非门L1、D触发器D1、第一与门L2、第二与门L3、第一逻辑组合电路Cl、第一逻辑选择电路L4 和第二逻辑选择电路L5。其中，非门Ll的输入端与0 E信号输入端连接；非门Ll的输出端分别与第一与门L2的输入端和第二与门L3的输入端连接；D触发器Dl的触发端CKV与CPV信号输入端链接；D触发器Dl的输入端D与反向输出端巧连接；D触发器Dl的反向输出端G与第二与门L3的输入端连接；D触发器Dl的输出端Q与与门L2的输入端连接；D触发器Dl的复位端RST分别与STV信号输入端连接；第一逻辑组合电路Cl的输入端分别与CPV信号输入端、第一与门L2和第二与门 L3的输出端连接；第一逻辑组合电路Cl的输出端分别与第一逻辑选择电路L4和第二逻辑选择电路 L5连接；第一逻辑选择电路L4的输出端与CKV信号输出端连接；第二逻辑选择电路L5的输出端与CKVB信号输出端连接；第一逻辑选择电路L4和第二逻辑选择电路L5分别与参考选择高电压VON和参考选择低电压VOFF连接。图2中，D触发器Dl的输入端D、输出端Q、反向输出端巧端和复位端RST都是电子电路领域中公知的称呼，本发明实施例中不再具体解释。下面说明本发明实施例的薄膜晶体管液晶显示器的栅极驱动器的工作原理。图2 中，当CPV信号上升置高时，由于D触发器Dl的输入端D与反向输出端G连接，CPV信号作为边沿触发信号将D触发器Dl的输出反向，进而将第一逻辑组合电路Cl的输出反向，使得第一逻辑选择电路L4和第二 L5逻辑选择电路进行电平切换，进而将CKV信号和CKVB信号反相，使得给栅极的fete信号进行行切换；通过逻辑第一与门L2和第二与门L3将OE信号接入电路中，当OE信号上升置高时，经过非门Ll变为低，经过第一与门L2和第二与门L3 同时输出为低，通过第一逻辑组合电路Cl后将第一逻辑选择电路L4和第二逻辑选择电路 L5的信号同时接至低电压VOFF，CKV信号和CKVB信号输出低电压V0FF，从而使得在CKV信号的一个周期内，CKV信号的下降沿与CKVB信号的上升沿之间具有预先设置的时间间隔， 或者在CKVB信号的一个周期内，CKV信号的上升沿与CKVB信号的下降沿之间具有预先设置的时间间隔，进而使得栅极在预期时间关断。图3为本实用新型实施例一提供的薄膜晶体管液晶显示器的栅极驱动器的时序图，如图3所示，STV信号、OE信号和CPV信号是输入信号，CKV信号和CKVB信号是输出信号。通常CKV信号的上升沿和CKVB信号的上升沿都会输出一个fete信号，CKV信号和CKVB 信号周期相同，交替出现上升沿，这样就能顺次输出各行栅线的栅极驱动信号。从图3中可以看出，OE信号的下降沿对应CKV信号或CKVB信号的上升沿，而在CKV信号的一个周期内， CKV信号的下降沿与CKVB信号的上升沿之间相差OE信号的一个周期内高电平保持的时间； 在CKVB信号的一个周期内，CKVB信号的下降沿与CKV信号的上升沿之间也相差OE信号的一个周期内高电平保持的时间，这样即使CKV信号的下降沿和CKVB信号的下降沿有延时导致fete信号的下降沿有延时，也不会导致数据混淆，从而保证了画面显示的质量。进一步地，本实施例的上述输出端还可以用于输出STVP信号，即包括STVP信号输出端。相应地，处理电路还可以进一步包括第二逻辑组合电路C2和第二逻辑选择电路L6。 其中，第二逻辑组合电路C2的输入端分别与CPV信号输入端和STV信号输入端连接；第二逻辑组合电路C2的输出端与第三逻辑选择电路L6的输入端连接；第三逻辑选择电路L6的输出端与STVP信号输出端连接；第三逻辑选择电路L6与参考选择高电压VON和参考选择低电压VOFF相连接。具体地，STV信号通过第三逻辑选择电路L6进行电平转换生成STVP信号，以给第一行栅线进行充电。本实施例中，通过处理电路将现有技术中的STV信号、OE信号和CPV信号生成CKV 信号和CKVB信号，在CKV信号的一个周期内，CKV信号的下降沿与CKVB信号的上升沿之间能够错开一定时间，或者在CKVB信号的一个周期内，CKVB信号的下降沿与CKV信号的上升沿之间能够错开一定时间，从而能够避免由于栅极驱动信号的延迟造成的输入到像素电极中的数据混淆。本实用新型实施例还提供了一种薄膜晶体管液晶显示器的驱动电路，该驱动电路包括源极驱动器和栅极驱动器，上述的栅极驱动器采用上述实施例提供的薄膜晶体管液晶显示器的栅极驱动器。本实用新型实施例还提供了一种液晶显示器，包括外框架、液晶面板和驱动电路， 所述驱动电路采用上述薄膜晶体管液晶显示器的驱动电路。最后应说明的是以上实施例仅用以说明本实用新型的技术方案，而非对其限制； 尽管参照前述实施例对本实用新型进行了详细的说明，本领域的普通技术人员应当理解:其依然可以对前述各实施例所记载的技术方案进行修改，或者对其中部分技术特征进行等同替换；而这些修改或者替换，并不使相应技术方案的本质脱离本实用新型各实施例技术方案的精神和范围。
权利要求1.一种薄膜晶体管液晶显示器的栅极驱动器，其特征在于，包括用于输入CPV信号、OE 信号和STV信号的输入端，以及用于输出CKV信号和CKVB信号的输出端，所述输入端与所述输出端之间连接有处理电路，用于对所述CPV信号、所述OE信号和所述STV信号进行处理。
2.根据权利要求1所述的薄膜晶体管液晶显示器的栅极驱动器，其特征在于，所述处理电路包括非门Li、D触发器D1、第一与门L2、第二与门L3、第一逻辑组合电路Cl、第一逻辑选择电路L4和第二逻辑选择电路L5，其中，非门Ll的输入端与OE信号输入端连接；非门Ll的输出端分别与第一与门L2的输入端和第二与门L3的输入端连接； D触发器Dl的触发端CKV与CPV信号输入端链接； D触发器Dl的输入端D与反向输出端巧连接； D触发器Dl的反向输出端巧与第二与门L3的输入端连接； D触发器Dl的输出端Q与与门L2的输入端连接； D触发器Dl的复位端RST分别与STV信号输入端连接；第一逻辑组合电路Cl的输入端分别与CPV信号输入端、第一与门L2和第二与门L3的输出端连接；第一逻辑组合电路Cl的输出端分别与第一逻辑选择电路L4和第二逻辑选择电路L5 连接；第一逻辑选择电路L4的输出端与CKV信号输出端连接； 第二逻辑选择电路L5的输出端与CKVB信号输出端连接；第一逻辑选择电路L4和第二逻辑选择电路L5分别与参考选择高电压VON和参考选择低电压VOFF连接。
3.根据权利要求1所述的薄膜晶体管液晶显示器的栅极驱动器，其特征在于，所述输出端还用于输出STVP信号；所述处理电路还包括第二逻辑组合电路C2和第二逻辑选择电路L6，其中，第二逻辑组合电路C2的输入端分别与CPV信号输入端和STV信号输入端连接； 第二逻辑组合电路C2的输出端与第三逻辑选择电路L6的输入端连接； 第三逻辑选择电路L6的输出端与STVP信号输出端连接； 第三逻辑选择电路L6与参考选择高电压VON和参考选择低电压VOFF相连接。
4.一种薄膜晶体管液晶显示器的驱动电路，包括源极驱动器和栅极驱动器，其特征在于，所述栅极驱动器采用权利要求1至3任一权利要求所述的栅极驱动器。
5.一种薄膜晶体管液晶显示器，包括外框架、液晶面板和驱动电路，其特征在于，所述驱动电路采用权利要求4所述的薄膜晶体管液晶显示器的驱动电路。
专利摘要本实用新型公开了一种薄膜晶体管液晶显示器的栅极驱动器、驱动电路及液晶显示器，其中，薄膜晶体管液晶显示器的栅极驱动器包括用于输入CPV信号、OE信号和STV信号的输入端，以及用于输出CKV信号和CKVB信号的输出端，输入端与输出端之间连接有处理电路，用于对CPV信号、OE信号和STV信号进行处理，以使在CKV信号的一个周期内，CKV信号的下降沿与CKVB信号的上升沿之间具有预先设置的时间间隔，或者在CKVB信号的一个周期内，CKV信号的上升沿与CKVB信号的下降沿之间具有预先设置的时间间隔。本实用新型能够避免由于栅极驱动信号的延迟造成的输入到像素电极中的数据混淆。
文档编号G09G3/36GK202008813SQ20102067770
公开日2011年10月12日 申请日期2010年12月23日 优先权日2010年12月23日
发明者王洁琼 申请人:北京京东方光电科技有限公司
技术领域：
本实用新型涉及液晶显示器驱动技术，尤其涉及一种薄膜晶体管液晶显示器的栅极驱动器、驱动电路及液晶显示器。
背景技术：
液晶显示器是目前常用的平板显示器，其中薄膜晶体管液晶显示器(ThinFilm Transistor Liquid Crystal Display，简称TFT-LCD)是液晶显示器中的主流产品。如图1 所示为现有技术中TFT-LCD的驱动电路结构示意图，时序控制器1用于产生各种控制信号， 例如栅极行开启信号(本领域中通常称为CPV信号(Clock Pulse Vertical，简称CPV))、 栅极帧开启信号(本领域中通常称为STV信号(Mart Vertical，简称STV))、栅极输出使能信号(本领域中通常称为OE信号(Output Enable，简称OE))等。时序控制器1将产生的各种控制信号输入到高电压逻辑驱动器(High VoltageTFT-LCD Logic Driver) 2中，该高电压逻辑驱动器2将CPV信号、STV信号、OE信号等生成第一时钟信号(本领域中通常称为CKV信号)、第二时钟信号(本领域中通常称为CKVB信号)以及改进后STV信号(本领域中通常称为STVP信号)，所谓改进后的STV信号是指电平经过调整后的STV信号，因为时序控制器中输出的STV信号的电平和栅极驱动电路需要的STV信号的电平可能不一致，需要通过一些电平转换电路将STV信号的电平进行转换。CKVB信号、CKV信号和STVP信号输入到栅极驱动电路3中，就可以驱动栅极工作了。TFT-LCD的驱动电路中，通常当栅极驱动电路输出用于开启一行栅线的栅极驱动信号(本领域中通常称为fete信号)时，源极驱动电路将该行栅线对应的各个像素的数据信号输入到该行的各个像素电极上，即当fete信号为高电平时，源极驱动电路向像素电极上输入数据信号。实际应用当中，Gate信号的下降沿有一定的延时，那么当前一行的(iatel 信号正处于下降沿时，后一行的信号已经开始上升，那么也就是说前一行栅线对应的各个TFT还没有关断，这时源极驱动电路已经输入了后一行像素对应的数据，从而导致了前一行像素的数据发生混淆，影响了画面显示的质量。
实用新型内容本实用新型提供一种薄膜晶体管液晶显示器的栅极驱动器、驱动电路及液晶显示器，用以避免由于栅极驱动信号的延迟造成输入到像素电极中的数据混淆。本实用新型提供一种薄膜晶体管液晶显示器的栅极驱动器，包括用于输入CPV信号、OE信号和STV信号的输入端，以及用于输出CKV信号和CKVB信号的输出端，所述输入端与所述输出端之间连接有处理电路，用于对所述CPV信号、所述OE信号和所述STV信号进行处理，以使在所述CKV信号的一个周期内，所述CKV信号的下降沿与所述CKVB信号的上升沿之间具有预先设置的时间间隔，或者在所述CKVB信号的一个周期内，所述CKV信号的上升沿与所述CKVB信号的下降沿之间具有预先设置的时间间隔。[0006]如上所述的薄膜晶体管液晶显示器的栅极驱动器，其中，所述处理电路包括非门 LUD触发器D1、第一与门L2、第二与门L3、第一逻辑组合电路Cl、第一逻辑选择电路L4和第二逻辑选择电路L5，其中，非门Ll的输入端与OE信号输入端连接；非门Ll的输出端分别与第一与门L2的输入端和第二与门L3的输入端连接；D触发器Dl的触发端CKV与CPV信号输入端链接；D触发器Dl的输入端D与反向输出端巧连接；D触发器Dl的反向输出端G与第二与门L3的输入端连接；D触发器Dl的输出端Q与与门L2的输入端连接；D触发器Dl的复位端RST分别与STV信号输入端连接；第一逻辑组合电路Cl的输入端分别与CPV信号输入端、第一与门L2和第二与门 L3的输出端连接；第一逻辑组合电路Cl的输出端分别与第一逻辑选择电路L4和第二逻辑选择电路 L5连接；第一逻辑选择电路L4的输出端与CKV信号输出端连接；第二逻辑选择电路L5的输出端与CKVB信号输出端连接；第一逻辑选择电路L4和第二逻辑选择电路L5分别与参考选择高电压VON和参考选择低电压VOFF连接。如上所述的薄膜晶体管液晶显示器的栅极驱动器，其中，所述输出端还用于输出 STVP信号。如上所述的薄膜晶体管液晶显示器的栅极驱动器，其中，所述时间间隔为所述OE 信号高电平持续的时间。本实用新型提供一种薄膜晶体管液晶显示器的驱动电路，包括源极驱动器和栅极驱动器，其中，所述栅极驱动器采用上述栅极驱动器。本实用新型提供一种薄膜晶体管液晶显示器，包括外框架、液晶面板和驱动电路， 其中，所述驱动电路采用上述薄膜晶体管液晶显示器的驱动电路。本实用新型提供的薄膜晶体管液晶显示器的栅极驱动器、驱动电路及液晶显示器，通过处理电路将现有技术中的STV信号、OE信号和CPV信号生成CKV信号和CKVB信号， 在CKV信号的一个周期内，CKV信号的下降沿与CKVB信号的上升沿之间能够错开一定时间， 或者在CKVB信号的一个周期内，CKVB信号的下降沿与CKV信号的上升沿之间能够错开一定时间，从而能够避免由于栅极驱动信号的延迟造成的输入到像素电极中的数据混淆。
图1为现有技术中薄膜晶体管液晶显示器的驱动电路的结构示意图；图2为本实用新型实施例一提供的薄膜晶体管液晶显示器的栅极驱动器的结构示意图；图3为本实用新型实施例一提供的薄膜晶体管液晶显示器的栅极驱动器的时序图。
具体实施方式
为使本实用新型实施例的目的、技术方案和优点更加清楚，下面将结合本实用新型实施例中的附图，对本实用新型实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例是本实用新型一部分实施例，而不是全部的实施例。基于本实用新型中的实施例，本领域普通技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本实用新型保护的范围。图2为本实用新型实施例一提供的薄膜晶体管液晶显示器的栅极驱动器的结构示意图，如图2所示，本实用新型的薄膜晶体管液晶显示器的栅极驱动器可以包括用于输入CPV信号、OE信号和STV信号的输入端，以及用于输出CKV信号和CKVB信号的输出端，上述输入端与上述输出端之间连接有处理电路，用于对上述CPV信号、上述OE信号和上述STV 信号进行处理，以使在上述CKV信号的一个周期内，上述CKV信号的下降沿与上述CKVB信号的上升沿之间具有预先设置的时间间隔，或者在上述CKVB信号的一个周期内，上述CKV 信号的上升沿与上述CKVB信号的下降沿之间具有预先设置的时间间隔。具体地，上述输入端可以包括输入CPV信号的CPV信号输入端、输入OE信号的OE 信号输入端和输入STV信号的STV信号输入端；上述输出端可以包括输出CKV信号的CKV 信号输出端和输出CKVB信号的CKVB信号输出端。具体地，输入端INPUT可以包括CPV信号输入端、OE信号输入端和STV信号输入端。输出端OUTPUT可以包括CKV信号输出端和CKVB信号输出端。处理电路可以包括非门L1、D触发器D1、第一与门L2、第二与门L3、第一逻辑组合电路Cl、第一逻辑选择电路L4 和第二逻辑选择电路L5。其中，非门Ll的输入端与0 E信号输入端连接；非门Ll的输出端分别与第一与门L2的输入端和第二与门L3的输入端连接；D触发器Dl的触发端CKV与CPV信号输入端链接；D触发器Dl的输入端D与反向输出端巧连接；D触发器Dl的反向输出端G与第二与门L3的输入端连接；D触发器Dl的输出端Q与与门L2的输入端连接；D触发器Dl的复位端RST分别与STV信号输入端连接；第一逻辑组合电路Cl的输入端分别与CPV信号输入端、第一与门L2和第二与门 L3的输出端连接；第一逻辑组合电路Cl的输出端分别与第一逻辑选择电路L4和第二逻辑选择电路 L5连接；第一逻辑选择电路L4的输出端与CKV信号输出端连接；第二逻辑选择电路L5的输出端与CKVB信号输出端连接；第一逻辑选择电路L4和第二逻辑选择电路L5分别与参考选择高电压VON和参考选择低电压VOFF连接。图2中，D触发器Dl的输入端D、输出端Q、反向输出端巧端和复位端RST都是电子电路领域中公知的称呼，本发明实施例中不再具体解释。下面说明本发明实施例的薄膜晶体管液晶显示器的栅极驱动器的工作原理。图2 中，当CPV信号上升置高时，由于D触发器Dl的输入端D与反向输出端G连接，CPV信号作为边沿触发信号将D触发器Dl的输出反向，进而将第一逻辑组合电路Cl的输出反向，使得第一逻辑选择电路L4和第二 L5逻辑选择电路进行电平切换，进而将CKV信号和CKVB信号反相，使得给栅极的fete信号进行行切换；通过逻辑第一与门L2和第二与门L3将OE信号接入电路中，当OE信号上升置高时，经过非门Ll变为低，经过第一与门L2和第二与门L3 同时输出为低，通过第一逻辑组合电路Cl后将第一逻辑选择电路L4和第二逻辑选择电路 L5的信号同时接至低电压VOFF，CKV信号和CKVB信号输出低电压V0FF，从而使得在CKV信号的一个周期内，CKV信号的下降沿与CKVB信号的上升沿之间具有预先设置的时间间隔， 或者在CKVB信号的一个周期内，CKV信号的上升沿与CKVB信号的下降沿之间具有预先设置的时间间隔，进而使得栅极在预期时间关断。图3为本实用新型实施例一提供的薄膜晶体管液晶显示器的栅极驱动器的时序图，如图3所示，STV信号、OE信号和CPV信号是输入信号，CKV信号和CKVB信号是输出信号。通常CKV信号的上升沿和CKVB信号的上升沿都会输出一个fete信号，CKV信号和CKVB 信号周期相同，交替出现上升沿，这样就能顺次输出各行栅线的栅极驱动信号。从图3中可以看出，OE信号的下降沿对应CKV信号或CKVB信号的上升沿，而在CKV信号的一个周期内， CKV信号的下降沿与CKVB信号的上升沿之间相差OE信号的一个周期内高电平保持的时间； 在CKVB信号的一个周期内，CKVB信号的下降沿与CKV信号的上升沿之间也相差OE信号的一个周期内高电平保持的时间，这样即使CKV信号的下降沿和CKVB信号的下降沿有延时导致fete信号的下降沿有延时，也不会导致数据混淆，从而保证了画面显示的质量。进一步地，本实施例的上述输出端还可以用于输出STVP信号，即包括STVP信号输出端。相应地，处理电路还可以进一步包括第二逻辑组合电路C2和第二逻辑选择电路L6。 其中，第二逻辑组合电路C2的输入端分别与CPV信号输入端和STV信号输入端连接；第二逻辑组合电路C2的输出端与第三逻辑选择电路L6的输入端连接；第三逻辑选择电路L6的输出端与STVP信号输出端连接；第三逻辑选择电路L6与参考选择高电压VON和参考选择低电压VOFF相连接。具体地，STV信号通过第三逻辑选择电路L6进行电平转换生成STVP信号，以给第一行栅线进行充电。本实施例中，通过处理电路将现有技术中的STV信号、OE信号和CPV信号生成CKV 信号和CKVB信号，在CKV信号的一个周期内，CKV信号的下降沿与CKVB信号的上升沿之间能够错开一定时间，或者在CKVB信号的一个周期内，CKVB信号的下降沿与CKV信号的上升沿之间能够错开一定时间，从而能够避免由于栅极驱动信号的延迟造成的输入到像素电极中的数据混淆。本实用新型实施例还提供了一种薄膜晶体管液晶显示器的驱动电路，该驱动电路包括源极驱动器和栅极驱动器，上述的栅极驱动器采用上述实施例提供的薄膜晶体管液晶显示器的栅极驱动器。本实用新型实施例还提供了一种液晶显示器，包括外框架、液晶面板和驱动电路， 所述驱动电路采用上述薄膜晶体管液晶显示器的驱动电路。最后应说明的是以上实施例仅用以说明本实用新型的技术方案，而非对其限制； 尽管参照前述实施例对本实用新型进行了详细的说明，本领域的普通技术人员应当理解:其依然可以对前述各实施例所记载的技术方案进行修改，或者对其中部分技术特征进行等同替换；而这些修改或者替换，并不使相应技术方案的本质脱离本实用新型各实施例技术方案的精神和范围。
权利要求1.一种薄膜晶体管液晶显示器的栅极驱动器，其特征在于，包括用于输入CPV信号、OE 信号和STV信号的输入端，以及用于输出CKV信号和CKVB信号的输出端，所述输入端与所述输出端之间连接有处理电路，用于对所述CPV信号、所述OE信号和所述STV信号进行处理。
2.根据权利要求1所述的薄膜晶体管液晶显示器的栅极驱动器，其特征在于，所述处理电路包括非门Li、D触发器D1、第一与门L2、第二与门L3、第一逻辑组合电路Cl、第一逻辑选择电路L4和第二逻辑选择电路L5，其中，非门Ll的输入端与OE信号输入端连接；非门Ll的输出端分别与第一与门L2的输入端和第二与门L3的输入端连接； D触发器Dl的触发端CKV与CPV信号输入端链接； D触发器Dl的输入端D与反向输出端巧连接； D触发器Dl的反向输出端巧与第二与门L3的输入端连接； D触发器Dl的输出端Q与与门L2的输入端连接； D触发器Dl的复位端RST分别与STV信号输入端连接；第一逻辑组合电路Cl的输入端分别与CPV信号输入端、第一与门L2和第二与门L3的输出端连接；第一逻辑组合电路Cl的输出端分别与第一逻辑选择电路L4和第二逻辑选择电路L5 连接；第一逻辑选择电路L4的输出端与CKV信号输出端连接； 第二逻辑选择电路L5的输出端与CKVB信号输出端连接；第一逻辑选择电路L4和第二逻辑选择电路L5分别与参考选择高电压VON和参考选择低电压VOFF连接。
3.根据权利要求1所述的薄膜晶体管液晶显示器的栅极驱动器，其特征在于，所述输出端还用于输出STVP信号；所述处理电路还包括第二逻辑组合电路C2和第二逻辑选择电路L6，其中，第二逻辑组合电路C2的输入端分别与CPV信号输入端和STV信号输入端连接； 第二逻辑组合电路C2的输出端与第三逻辑选择电路L6的输入端连接； 第三逻辑选择电路L6的输出端与STVP信号输出端连接； 第三逻辑选择电路L6与参考选择高电压VON和参考选择低电压VOFF相连接。
4.一种薄膜晶体管液晶显示器的驱动电路，包括源极驱动器和栅极驱动器，其特征在于，所述栅极驱动器采用权利要求1至3任一权利要求所述的栅极驱动器。
5.一种薄膜晶体管液晶显示器，包括外框架、液晶面板和驱动电路，其特征在于，所述驱动电路采用权利要求4所述的薄膜晶体管液晶显示器的驱动电路。
专利摘要本实用新型公开了一种薄膜晶体管液晶显示器的栅极驱动器、驱动电路及液晶显示器，其中，薄膜晶体管液晶显示器的栅极驱动器包括用于输入CPV信号、OE信号和STV信号的输入端，以及用于输出CKV信号和CKVB信号的输出端，输入端与输出端之间连接有处理电路，用于对CPV信号、OE信号和STV信号进行处理，以使在CKV信号的一个周期内，CKV信号的下降沿与CKVB信号的上升沿之间具有预先设置的时间间隔，或者在CKVB信号的一个周期内，CKV信号的上升沿与CKVB信号的下降沿之间具有预先设置的时间间隔。本实用新型能够避免由于栅极驱动信号的延迟造成的输入到像素电极中的数据混淆。
文档编号G09G3/36GK202008813SQ20102067770
公开日2011年10月12日 申请日期2010年12月23日 优先权日2010年12月23日
发明者王洁琼 申请人:北京京东方光电科技有限公司
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